visio中的门的形状在哪 有哪些适合大学生学习的网站推荐？

有哪些适合大学生学习的网站推荐？

一.哔哩哔哩

年轻人的聚集地，不仅戏曲和鬼畜很酷，一些教程和直播也很酷。

第二，教程和自学网站

腾讯课堂:学习内容非常丰富，包括计算机、法律、会计、美术、英语和生活的一些方面。

大规模开放在线课程网

学习计算机的最佳选择，html，java，python，vue.js……...

三、职位招聘类

高校人才网:招聘求职的好去处

对于各大专业，以及中小学，医学，科研人才。还有一些大学招聘信息。

第四，考试，高级班

教育考试网

不用说，四六级，雅思，托福都离不开它。

五、千图网、知心地图网、花瓣网，这些都是一些素材网站，难免要设计一些图片。

6.大学慕课

这个网站可以不要分开。几千所名校提供免费课程，无论是预习还是复习都是不错的选择。

visio怎样画门？

如果您需要在visio中绘制门，您可以从模块工具中调用建筑模块，并将所需类型的门拖动到所需位置并调整其大小。

门电路符号在word中如何输入？

在word中直接输入门符号并不容易。如果你必须以这种输入它们，你必须插入图形。

在office中做电路，要用officevisio这个软件，它是office家族的一员，是制作电路图、流程图等等的专用软件。它做出的图纸可以直接转到word。

微软formula3.0主要是做公式，没有做电路图的能力。

总结数字电路设计的一般方法？

我来自西北工业大学计算机学院微电子研究所。现在我是微电子学院一年级的学生。我的专业是数字集成电路设计。研究生一上学期，初步掌握了数字集成电路后端综合设计方法。本学术素养课程报告主要讨论后端流程的实现。方法、经验和相关见解。

一般来说，软件工程师和硬件工程师的需求量是10:1，也就是说，硬件工程师的需求量远远小于软件工程师，硬件工程师分为模拟类和数字类。模拟集成电路设计主要包括adc、dac、pll等。数字设备。完成的电路设计更倾向于实现特定功能的芯片，如cpu、gpu、mcu、mpu、dsp等。

事实上，在这个阶段，数字集成电路的设计方法已经非常类似于借助eda工具进行软件开发。典型的数字集成电路开发一般包括以下步骤:

1.根据需求，自上而下设计电路模块，明确数字系统需要实现哪些功能，再细分成各个功能模块。这时候的设计形式一般是框图，用visio或者其他绘图软件实现。这个环节是松散的，但却是非常重要的，因为根据在设计大模块和指标时，一定要结合实际情况，否则后期会经过无限的返工，甚至达不到预定的指标。一般由德高望重、经验丰富的工程师进行整体设计。

2.定义好每个模块之后，接下来就是实现每个模块的功能。由于硬件描述语言的存在，我们可以很容易地"写作与写作通过硬件描述语言的模块实现方法。在这个实验中，我使用了veriloghdl。绝对代码复杂度与模块的复杂度有关。在这个实验中，我使用了"八位格雷码计数器"。

3.在完成了"八位格雷码计数器"，有必要"预模拟和模拟设计。所谓预仿真，主要是验证代码描述是否正确，计划的功能是否真正实现。一般用modelsim软件进行仿真，仿真是成功的。进入下一阶段。如果不成功，需要返回修改后的代码。

4.预仿真成功后，即可得到功能正确的verilog设计代码。此时可以将代码下载到fpga板上进行验证(jtagquartus)，证明设计是正确的。对于一些低集成要求和非常紧迫的时间数字电路设计项目，可以直接用fpga实现芯片功能。显然，fpga这种通用器件可以不能满足asic高集成度、低功耗、高专用性的设计要求，只能用于相对简单粗糙的设计。

5.接下来，进入后端流程。这时候就需要专门的服务器和昂贵的eda工具。这也是硬件设计入门难的原因之一。如果一个没有接触过软件编程的有志青年立志做软件工程，一般一台电脑，一本书就够了，最多。买正版编译器(vs，eclipse，dw等。)，但是做硬件电路设计，一台电脑一本书最多能画pcb。要成为核心部分，你必须使用强大的服务器和昂贵的eda工具，因为普通pc可以我负担不起"后端和综合"工作要求。而且linux下大量复杂的操作会让人望而却步。

6.在后端平台准备好之后，您可以将"八位格雷码计数器"进了站台。这时候应该马上考虑什么组件库和流程？因为同一个与非门，不同的元器件库实现细节不同，mos管的细节可能差别很大，另外还需要测试。考虑到工艺，这些工艺文件来自相关制造商(tsmc、csms等。)，这也是个人能够不要做后端——因为你几乎不可能以自己的名义与tsmc讨论工艺库文档。毕竟，作为一个没有经验，没有钱和技能的初学者，你可以不要装满它。有信心和一个几万人几亿资金的工艺厂签约。仔细筛选后(很多情况下没得选)，确定你要用的流程。在这个实验中，我使用了我的高级实验室改进的组件库和tsmc0.18um技术，eda工具是ca。danceic614

7.经过一系列的配置后,"八位格雷码计数器"已经变成了一个巨大的工程文件。我建议使用tcl脚本文件进行配置。然后可以进行rtl级合成。所谓rtl级合成其实指的是"重写"verilog代码合成。工具(我用的是encounter)可以识别的verilog代码。一般来说，这类似于翻译"古典文学与艺术进入"白话文与汉语和"编译与编辑在c语言中，就是把一种高级语言翻译成汇编代码。当然，理论可以直接写rt。l级代码，但这就跟直接写汇编语言一样，复杂程度不言而喻。

8.rtl级合成完成后，将rtlverilog导入到encounter中进行真正的后端合成。导入rtl码后，还需要解释标准单元库的lef文件，定义电源和地的线名。这个时候需要一个mmmc骗局。fig配置的过程比较复杂，主要是相关文件和设备状态(tt、ss、ff等。).

9.完成导入配置，然后是芯片版图设计，即布图。floorplan需要设置一些基本的参数，比如芯片的长宽(面积)，引脚留的空间，芯片利用率等等。纵横比建议为0.2-5，复杂电路利用率为0.8。5、一般电路利用率0.90，简单电路利用率0.95。

10.电力计算，电力线路排列的依据，主要为环形和条形。比如数字电路芯片功耗55mw，冗余增加到2倍左右。设计为100mw，电流约60ma，这是总电量。源线60u。如果每条线都是10u，那么就有六条电源线，一边一条，中间四条。在遭遇中有一个特殊的接线配置器。接线后，可以先申请，再取消重复尝试。

11.排列io引脚。如果没有提前导入io，可以重新导入(tcl)或者自行调整。

12.前置，因为verilog中往往有很多模块，每个模块对应一个布局模块。布局时要注意一些布局原则。布局一般可以通过简单的拖动来完成。"八位格雷码计数器"因为只有一个模块，所以你不不需要复杂的布局。

13.布局是一个不断修改和改进的过程。放置是在前置后进行，然后是后置。布局之后，需要时钟树综合(cts)。cts的目的是使每个信号都受到约束。会及时传输到下一个顺序单元，否则会影响芯片的主频(主频是设计前确定的指标)，然后在post-cts中调整不满足时钟约束的部分的布线。

14.布局后路由，即路由。特殊走线，需要先走线，再后置。这些步骤在某种程度上是"点按钮"和"参数匹配"，但是后端合成一定要头脑清醒，一定要知道为什么。单击这些按钮以及要配置的参数。

15.经过多次迭代，配置好io引脚后，就可以填充整张图片，用各种金属层覆盖不用的区域。单人"八位格雷码计数器"由于其结构简单而具有较大的未覆盖面积。

16.至此，encounter中的后端综合已经完成，网表可以导出为gdsii格式，为了检查drc和lvs，还需要"网表"转换成示意图格式。

17.将后端集成的gdsii文件导入virtuoso。virtuoso是一款模拟集成电路设计软件。将gdsii文件导入该软件有两个主要目的。一种是在virtuoso中导入gdsii文件。do"后期模拟与设计来验证概念芯片经过一系列的后端综合的过程后是否能达到设计要求。此时仿真已经考虑到了延迟、电阻、功耗等实际问题。如果仿真有问题，需要返工修改，必要时重新布线。当...的时候“后仿真”通过后，还要对该芯片进行drc和lvs检查，drc是查看是否满足所选工艺的要求，因为在实际情况下，一些理论上的值是不现实的，比如过细的线无法生产，栅极间的距离过短可能会导致短路，导线和各金属层间电容会影响电路功能等等。lvs是比较版图和原理图之间的拓扑关系是否不一致。第二，方便以后设计数模混合芯片，因为模拟集成电路直接在virtuoso中进行。最后，两者可以结合在一起，设计一个混合信号集成电路。

18.检验后，您可以联系工艺供应商进行加工，如tsmc。一般处理需要跟上企业的业务流程。大约一个月后，芯片加工完毕，然后进入测试阶段。焊接，测试，验证芯片指标，提出改进方案。

至此，一个数字集成电路从概念到实物的全过程已经完成，每一步都值得研究和回味。从24解码器到复杂的cpu，过程基本相同。一个学期后的学习，我基本掌握了这个流程。我以后会在这所大学更加努力行业的方向继续前进，培养核心竞争力。

设计芯片软件模块集成电路